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Verilog基本语法中通常表示不确定的逻辑状态和高阻态的符号是

中国大学MOOC答案 数据帝 2024-05-09 扫描二维码

A、x和z
B、z和x
C、z和Z
D、x和X
E、x和y
F、y和Y
喵查答案：x和z

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